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機(jī)電電路防干擾手段德探究

機(jī)電電路防干擾手段德探究

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級(jí)別:| 積分:0 分 | 瀏覽:79875 | 大小:25.00KB | 下載:4425 次 | 上傳:2013-11-07

簡(jiǎn)介:

  1硬件抗干擾措施( 1)電路設(shè)計(jì)1)嚴(yán)格選擇元器件要選擇質(zhì)地優(yōu)良、性能好,經(jīng)過嚴(yán)格測(cè)試和老化處理的元器件,其邏輯器件的空閑輸入端不能懸空,應(yīng)接地或接入V cc,也可以與有用輸入端并聯(lián)。

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